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2013-05-23 12:21
求翻译：This paper presents the design of a universal asynchronous receiver and transmitter (UART), which is fully functional and synthesizeable. Due to its modularity, configurability and extremely compact size, the proposed UART is named as micro-UART and it is ideal for system-on-a-chip (SoC) application. The core is usable是什么意思？ 待解决
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This paper presents the design of a universal asynchronous receiver and transmitter (UART), which is fully functional and synthesizeable. Due to its modularity, configurability and extremely compact size, the proposed UART is named as micro-UART and it is ideal for system-on-a-chip (SoC) application. The core is usable
问题补充： |
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2013-05-23 12:21:38
本文介绍了通用异步接收器和发射器（UART），这是全面的功能和可综合的设计。由于其模块化，可配置性和极其紧凑的尺寸，建议UART被命名为微UART，它是单芯片系统（SOC）应用的理想选择。核心可用作知识产权。已被用于其设计，编译和仿真Verilog硬件描述语言（HDL）在Altera的MAX-PLUS II环境。已实施的UART使用Altera的FPGA技术。 ©2004爱思唯尔有限公司。保留所有权利。关键字：UART; HDL; FPGA; SOC;串行通信
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2013-05-23 12:23:18
本文介绍了设计的一个通用异步接收器 发送器(uart),这是完全正常和synthesizeable。 由于它的模块化设计、可配置性和极其紧凑的尺寸,uart是命名的建议作为微型uart和它是一个很理想的片上系统(soc)应用程序。 其核心是用作一个知识产权。 verilog硬件描述语言(hdl)在altera的最大的环境加上二一直使用其设计、编译和仿真模拟。
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2013-05-23 12:24:58
本文提出一台普遍异步接收器和发射机(UART的)设计，充分地工作和synthesizeable。 由于它的模块化、可配置性和极端袖珍型，提出的UART被命名，因为微UART和它为系统在芯片(SoC)应用是理想的。 核心是能用的作为知识产权。 Verilog硬件描述语言(HDL)在Altera的MAX-PLUS II环境里为它的设计、编辑和模仿使用了。 UART使用Altera的FPGA技术被实施了。 ©2004 Elsevier有限公司。 版权所有。 主题词： UART; HDL; FPGA; SoC; 串行通信
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2013-05-23 12:26:38
本文介绍通用异步收发 (UART)，这是完全功能和 synthesizeable 的设计。由于其模块化、 可配置性和非常紧凑的大小，拟议的 UART 命名为微 UART 和它是系统上-芯片 (SoC) 应用的理想选择。核心是可用作为知识产权。Altera MAX-PLUS II 环境语言硬件描述语言 （HDL） 被用于其设计、 汇编和仿真。已使用的 Altera FPGA 技术实施 UART。© 2004 Elsevier 有限公司保留所有的权利。关键字: UART ；高密度脂蛋白 ；FPGA ；SoC ；串行通讯
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2013-05-23 12:28:18
这篇文章赠送一位宇宙异步性的接收者和传送者的作品 (UART)，是全功能和可合成的。由于其模块性，可配置性和非常紧凑的大小，拟议的 UART 命名被为微 UART 和它是适用于系统芯片 ( SoC ) 申请。核心是可用的作为知识产权。Verilog 硬件描述语言 (HDL) 在 Altera 的最大以上 II 种环境中用于了其设计，编辑和模拟。UART 使用 Altera 的 FPGA 技术被实施了。(C)2004 年 Elsevier Ltd.All 权利保留。关键字：UART ；HDL ；FPGA ；SoC ；连续通信
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